Erschienen: 13.05.2003 Abbildung von Lee | Verilog Coding for Logic Synthesis | 2003

Lee

Verilog Coding for Logic Synthesis

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inkl. Mwst.

2003. Buch. 310 S. Hardcover

WILEY. ISBN 978-0-471-42976-0

Format (B x L): 16,3 x 23,9 cm

Gewicht: 595 g

In englischer Sprache

Produktbeschreibung

Provides a practical approach to Verilog design and problem solving.
* Bulk of the book deals with practical design problems that design engineers solve on a daily basis.
* Includes over 90 design examples.
* There are 3 full scale design examples that include specification, architectural definition, micro-architectural definition, RTL coding, testbench coding and verification.
* Book is suitable for use as a textbook in EE departments that have VLSI courses

Gesamtwerk

Die 8. Auflage ist wieder auf sechs Bände angelegt. Darin finden sich übersichtlich und in systematischer Gliederung Vertragsmuster aus der Feder erfahrener Experten. Jedem dieser Muster folgen Anmerkungen, mit denen der dem Vertragsentwurf zu Grunde liegende Sachverhalt und die Gründe für die Wahl des spezifischen Formulars erläutert werden.

Autoren

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